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[AArch64 NEON] Expand vector for UDIV/SDIV/UREM/SREM/FREM as neon doesn't support these operations.
llvm-svn: 199485
This commit is contained in:
Kevin Qin
parent
f8f0015b45
commit
e0faea11b1
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@ -403,6 +403,61 @@ AArch64TargetLowering::AArch64TargetLowering(AArch64TargetMachine &TM)
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setOperationAction(ISD::FP_TO_UINT, MVT::v2i32, Custom);
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setOperationAction(ISD::FP_TO_UINT, MVT::v2i64, Custom);
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// Neon does not support vector divide/remainder operations except
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// floating-point divide.
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setOperationAction(ISD::SDIV, MVT::v1i8, Expand);
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setOperationAction(ISD::SDIV, MVT::v8i8, Expand);
|
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setOperationAction(ISD::SDIV, MVT::v16i8, Expand);
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setOperationAction(ISD::SDIV, MVT::v1i16, Expand);
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||||
setOperationAction(ISD::SDIV, MVT::v4i16, Expand);
|
||||
setOperationAction(ISD::SDIV, MVT::v8i16, Expand);
|
||||
setOperationAction(ISD::SDIV, MVT::v1i32, Expand);
|
||||
setOperationAction(ISD::SDIV, MVT::v2i32, Expand);
|
||||
setOperationAction(ISD::SDIV, MVT::v4i32, Expand);
|
||||
setOperationAction(ISD::SDIV, MVT::v1i64, Expand);
|
||||
setOperationAction(ISD::SDIV, MVT::v2i64, Expand);
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||||
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setOperationAction(ISD::UDIV, MVT::v1i8, Expand);
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setOperationAction(ISD::UDIV, MVT::v8i8, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v16i8, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v1i16, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v4i16, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v8i16, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v1i32, Expand);
|
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setOperationAction(ISD::UDIV, MVT::v2i32, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v4i32, Expand);
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||||
setOperationAction(ISD::UDIV, MVT::v1i64, Expand);
|
||||
setOperationAction(ISD::UDIV, MVT::v2i64, Expand);
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setOperationAction(ISD::SREM, MVT::v1i8, Expand);
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setOperationAction(ISD::SREM, MVT::v8i8, Expand);
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setOperationAction(ISD::SREM, MVT::v16i8, Expand);
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setOperationAction(ISD::SREM, MVT::v1i16, Expand);
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setOperationAction(ISD::SREM, MVT::v4i16, Expand);
|
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setOperationAction(ISD::SREM, MVT::v8i16, Expand);
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setOperationAction(ISD::SREM, MVT::v1i32, Expand);
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setOperationAction(ISD::SREM, MVT::v2i32, Expand);
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setOperationAction(ISD::SREM, MVT::v4i32, Expand);
|
||||
setOperationAction(ISD::SREM, MVT::v1i64, Expand);
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setOperationAction(ISD::SREM, MVT::v2i64, Expand);
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setOperationAction(ISD::UREM, MVT::v1i8, Expand);
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setOperationAction(ISD::UREM, MVT::v8i8, Expand);
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setOperationAction(ISD::UREM, MVT::v16i8, Expand);
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setOperationAction(ISD::UREM, MVT::v1i16, Expand);
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setOperationAction(ISD::UREM, MVT::v4i16, Expand);
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setOperationAction(ISD::UREM, MVT::v8i16, Expand);
|
||||
setOperationAction(ISD::UREM, MVT::v1i32, Expand);
|
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setOperationAction(ISD::UREM, MVT::v2i32, Expand);
|
||||
setOperationAction(ISD::UREM, MVT::v4i32, Expand);
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setOperationAction(ISD::UREM, MVT::v1i64, Expand);
|
||||
setOperationAction(ISD::UREM, MVT::v2i64, Expand);
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setOperationAction(ISD::FREM, MVT::v2f32, Expand);
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||||
setOperationAction(ISD::FREM, MVT::v4f32, Expand);
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||||
setOperationAction(ISD::FREM, MVT::v1f64, Expand);
|
||||
setOperationAction(ISD::FREM, MVT::v2f64, Expand);
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||||
// Vector ExtLoad and TruncStore are expanded.
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||||
for (unsigned I = MVT::FIRST_VECTOR_VALUETYPE;
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||||
I <= MVT::LAST_VECTOR_VALUETYPE; ++I) {
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@ -87,6 +87,543 @@ define <2 x double> @div2xdouble(<2 x double> %A, <2 x double> %B) {
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|||
ret <2 x double> %tmp3
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||||
}
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||||
define <1 x i8> @sdiv1x8(<1 x i8> %A, <1 x i8> %B) {
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <1 x i8> %A, %B;
|
||||
ret <1 x i8> %tmp3
|
||||
}
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||||
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||||
define <8 x i8> @sdiv8x8(<8 x i8> %A, <8 x i8> %B) {
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <8 x i8> %A, %B;
|
||||
ret <8 x i8> %tmp3
|
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}
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define <16 x i8> @sdiv16x8(<16 x i8> %A, <16 x i8> %B) {
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||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <16 x i8> %A, %B;
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||||
ret <16 x i8> %tmp3
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}
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define <1 x i16> @sdiv1x16(<1 x i16> %A, <1 x i16> %B) {
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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||||
%tmp3 = sdiv <1 x i16> %A, %B;
|
||||
ret <1 x i16> %tmp3
|
||||
}
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define <4 x i16> @sdiv4x16(<4 x i16> %A, <4 x i16> %B) {
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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%tmp3 = sdiv <4 x i16> %A, %B;
|
||||
ret <4 x i16> %tmp3
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}
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||||
define <8 x i16> @sdiv8x16(<8 x i16> %A, <8 x i16> %B) {
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||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <8 x i16> %A, %B;
|
||||
ret <8 x i16> %tmp3
|
||||
}
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define <1 x i32> @sdiv1x32(<1 x i32> %A, <1 x i32> %B) {
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||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <1 x i32> %A, %B;
|
||||
ret <1 x i32> %tmp3
|
||||
}
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||||
define <2 x i32> @sdiv2x32(<2 x i32> %A, <2 x i32> %B) {
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||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <2 x i32> %A, %B;
|
||||
ret <2 x i32> %tmp3
|
||||
}
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||||
define <4 x i32> @sdiv4x32(<4 x i32> %A, <4 x i32> %B) {
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = sdiv <4 x i32> %A, %B;
|
||||
ret <4 x i32> %tmp3
|
||||
}
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define <1 x i64> @sdiv1x64(<1 x i64> %A, <1 x i64> %B) {
|
||||
;CHECK: sdiv {{x[0-9]+}}, {{x[0-9]+}}, {{x[0-9]+}}
|
||||
%tmp3 = sdiv <1 x i64> %A, %B;
|
||||
ret <1 x i64> %tmp3
|
||||
}
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||||
define <2 x i64> @sdiv2x64(<2 x i64> %A, <2 x i64> %B) {
|
||||
;CHECK: sdiv {{x[0-9]+}}, {{x[0-9]+}}, {{x[0-9]+}}
|
||||
;CHECK: sdiv {{x[0-9]+}}, {{x[0-9]+}}, {{x[0-9]+}}
|
||||
%tmp3 = sdiv <2 x i64> %A, %B;
|
||||
ret <2 x i64> %tmp3
|
||||
}
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define <1 x i8> @udiv1x8(<1 x i8> %A, <1 x i8> %B) {
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|
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|
||||
}
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define <8 x i8> @udiv8x8(<8 x i8> %A, <8 x i8> %B) {
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|
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|
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|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
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||||
%tmp3 = udiv <8 x i8> %A, %B;
|
||||
ret <8 x i8> %tmp3
|
||||
}
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define <16 x i8> @udiv16x8(<16 x i8> %A, <16 x i8> %B) {
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;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
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;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <16 x i8> %A, %B;
|
||||
ret <16 x i8> %tmp3
|
||||
}
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||||
|
||||
define <1 x i16> @udiv1x16(<1 x i16> %A, <1 x i16> %B) {
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <1 x i16> %A, %B;
|
||||
ret <1 x i16> %tmp3
|
||||
}
|
||||
|
||||
define <4 x i16> @udiv4x16(<4 x i16> %A, <4 x i16> %B) {
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <4 x i16> %A, %B;
|
||||
ret <4 x i16> %tmp3
|
||||
}
|
||||
|
||||
define <8 x i16> @udiv8x16(<8 x i16> %A, <8 x i16> %B) {
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <8 x i16> %A, %B;
|
||||
ret <8 x i16> %tmp3
|
||||
}
|
||||
|
||||
define <1 x i32> @udiv1x32(<1 x i32> %A, <1 x i32> %B) {
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <1 x i32> %A, %B;
|
||||
ret <1 x i32> %tmp3
|
||||
}
|
||||
|
||||
define <2 x i32> @udiv2x32(<2 x i32> %A, <2 x i32> %B) {
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <2 x i32> %A, %B;
|
||||
ret <2 x i32> %tmp3
|
||||
}
|
||||
|
||||
define <4 x i32> @udiv4x32(<4 x i32> %A, <4 x i32> %B) {
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
;CHECK: udiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
||||
%tmp3 = udiv <4 x i32> %A, %B;
|
||||
ret <4 x i32> %tmp3
|
||||
}
|
||||
|
||||
define <1 x i64> @udiv1x64(<1 x i64> %A, <1 x i64> %B) {
|
||||
;CHECK: udiv {{x[0-9]+}}, {{x[0-9]+}}, {{x[0-9]+}}
|
||||
%tmp3 = udiv <1 x i64> %A, %B;
|
||||
ret <1 x i64> %tmp3
|
||||
}
|
||||
|
||||
define <2 x i64> @udiv2x64(<2 x i64> %A, <2 x i64> %B) {
|
||||
;CHECK: udiv {{x[0-9]+}}, {{x[0-9]+}}, {{x[0-9]+}}
|
||||
;CHECK: udiv {{x[0-9]+}}, {{x[0-9]+}}, {{x[0-9]+}}
|
||||
%tmp3 = udiv <2 x i64> %A, %B;
|
||||
ret <2 x i64> %tmp3
|
||||
}
|
||||
|
||||
define <1 x i8> @srem1x8(<1 x i8> %A, <1 x i8> %B) {
|
||||
;CHECK: sdiv {{w[0-9]+}}, {{w[0-9]+}}, {{w[0-9]+}}
|
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|
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|
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||||
; CHECK: bl fmodf
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|
||||
}
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|
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|
||||
; CHECK: bl fmodf
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||||
; CHECK: bl fmodf
|
||||
; CHECK: bl fmodf
|
||||
; CHECK: bl fmodf
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||||
%tmp3 = frem <4 x float> %A, %B;
|
||||
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|
||||
}
|
||||
|
||||
define <1 x double> @frem1d64(<1 x double> %A, <1 x double> %B) {
|
||||
; CHECK: bl fmod
|
||||
%tmp3 = frem <1 x double> %A, %B;
|
||||
ret <1 x double> %tmp3
|
||||
}
|
||||
|
||||
define <2 x double> @frem2d64(<2 x double> %A, <2 x double> %B) {
|
||||
; CHECK: bl fmod
|
||||
; CHECK: bl fmod
|
||||
%tmp3 = frem <2 x double> %A, %B;
|
||||
ret <2 x double> %tmp3
|
||||
}
|
||||
|
||||
declare <8 x i8> @llvm.arm.neon.vmulp.v8i8(<8 x i8>, <8 x i8>)
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||||
declare <16 x i8> @llvm.arm.neon.vmulp.v16i8(<16 x i8>, <16 x i8>)
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