PCI: Add R-Car Gen2 internal PCI support
This adds internal PCI controller driver for R-Car Gen2 SoC. There are three PCI controllers available with only a single EHCI/OHCI device built-in on each PCI bus. This gives us three USB channels. Channel 0 is shared with the USBHS device, while channel 2 is shared with the USBSS. The PCI controllers do not support I/O port space mapping, and it is not needed here. Signed-off-by: Valentine Barshak <valentine.barshak@cogentembedded.com> Signed-off-by: Bjorn Helgaas <bhelgaas@google.com>
This commit is contained in:
Valentine Barshak
Bjorn Helgaas
parent
4a10c2ac2f
commit
ba3eb9fce3
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@ -19,4 +19,12 @@ config PCI_TEGRA
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bool "NVIDIA Tegra PCIe controller"
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bool "NVIDIA Tegra PCIe controller"
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depends on ARCH_TEGRA
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depends on ARCH_TEGRA
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config PCI_RCAR_GEN2
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bool "Renesas R-Car Gen2 Internal PCI controller"
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depends on ARM && (ARCH_R8A7790 || ARCH_R8A7791 || COMPILE_TEST)
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help
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Say Y here if you want internal PCI support on R-Car Gen2 SoC.
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There are 3 internal PCI controllers available with a single
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built-in EHCI/OHCI host controller present on each one.
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endmenu
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endmenu
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@ -2,3 +2,4 @@ obj-$(CONFIG_PCIE_DW) += pcie-designware.o
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obj-$(CONFIG_PCI_EXYNOS) += pci-exynos.o
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obj-$(CONFIG_PCI_EXYNOS) += pci-exynos.o
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obj-$(CONFIG_PCI_MVEBU) += pci-mvebu.o
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obj-$(CONFIG_PCI_MVEBU) += pci-mvebu.o
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obj-$(CONFIG_PCI_TEGRA) += pci-tegra.o
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obj-$(CONFIG_PCI_TEGRA) += pci-tegra.o
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obj-$(CONFIG_PCI_RCAR_GEN2) += pci-rcar-gen2.o
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@ -0,0 +1,333 @@
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/*
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* pci-rcar-gen2: internal PCI bus support
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*
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* Copyright (C) 2013 Renesas Solutions Corp.
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|
* Copyright (C) 2013 Cogent Embedded, Inc.
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*
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* This program is free software; you can redistribute it and/or modify
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|
* it under the terms of the GNU General Public License version 2 as
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* published by the Free Software Foundation.
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*/
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#include <linux/delay.h>
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#include <linux/init.h>
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#include <linux/interrupt.h>
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#include <linux/io.h>
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#include <linux/kernel.h>
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#include <linux/module.h>
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#include <linux/pci.h>
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#include <linux/platform_device.h>
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#include <linux/slab.h>
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/* AHB-PCI Bridge PCI communication registers */
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#define RCAR_AHBPCI_PCICOM_OFFSET 0x800
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#define RCAR_PCIAHB_WIN1_CTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x00)
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#define RCAR_PCIAHB_WIN2_CTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x04)
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#define RCAR_PCIAHB_PREFETCH0 0x0
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#define RCAR_PCIAHB_PREFETCH4 0x1
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#define RCAR_PCIAHB_PREFETCH8 0x2
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#define RCAR_PCIAHB_PREFETCH16 0x3
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#define RCAR_AHBPCI_WIN1_CTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x10)
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#define RCAR_AHBPCI_WIN2_CTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x14)
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#define RCAR_AHBPCI_WIN_CTR_MEM (3 << 1)
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#define RCAR_AHBPCI_WIN_CTR_CFG (5 << 1)
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#define RCAR_AHBPCI_WIN1_HOST (1 << 30)
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#define RCAR_AHBPCI_WIN1_DEVICE (1 << 31)
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#define RCAR_PCI_INT_ENABLE_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x20)
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#define RCAR_PCI_INT_STATUS_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x24)
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#define RCAR_PCI_INT_A (1 << 16)
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#define RCAR_PCI_INT_B (1 << 17)
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#define RCAR_PCI_INT_PME (1 << 19)
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#define RCAR_AHB_BUS_CTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x30)
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#define RCAR_AHB_BUS_MMODE_HTRANS (1 << 0)
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#define RCAR_AHB_BUS_MMODE_BYTE_BURST (1 << 1)
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#define RCAR_AHB_BUS_MMODE_WR_INCR (1 << 2)
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||||||
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#define RCAR_AHB_BUS_MMODE_HBUS_REQ (1 << 7)
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#define RCAR_AHB_BUS_SMODE_READYCTR (1 << 17)
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#define RCAR_AHB_BUS_MODE (RCAR_AHB_BUS_MMODE_HTRANS | \
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RCAR_AHB_BUS_MMODE_BYTE_BURST | \
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|
RCAR_AHB_BUS_MMODE_WR_INCR | \
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RCAR_AHB_BUS_MMODE_HBUS_REQ | \
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RCAR_AHB_BUS_SMODE_READYCTR)
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#define RCAR_USBCTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x34)
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#define RCAR_USBCTR_USBH_RST (1 << 0)
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#define RCAR_USBCTR_PCICLK_MASK (1 << 1)
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#define RCAR_USBCTR_PLL_RST (1 << 2)
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#define RCAR_USBCTR_DIRPD (1 << 8)
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#define RCAR_USBCTR_PCIAHB_WIN2_EN (1 << 9)
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#define RCAR_USBCTR_PCIAHB_WIN1_256M (0 << 10)
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#define RCAR_USBCTR_PCIAHB_WIN1_512M (1 << 10)
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||||||
|
#define RCAR_USBCTR_PCIAHB_WIN1_1G (2 << 10)
|
||||||
|
#define RCAR_USBCTR_PCIAHB_WIN1_2G (3 << 10)
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||||||
|
#define RCAR_USBCTR_PCIAHB_WIN1_MASK (3 << 10)
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||||||
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||||||
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#define RCAR_PCI_ARBITER_CTR_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x40)
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||||||
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#define RCAR_PCI_ARBITER_PCIREQ0 (1 << 0)
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||||||
|
#define RCAR_PCI_ARBITER_PCIREQ1 (1 << 1)
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||||||
|
#define RCAR_PCI_ARBITER_PCIBP_MODE (1 << 12)
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||||||
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||||||
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#define RCAR_PCI_UNIT_REV_REG (RCAR_AHBPCI_PCICOM_OFFSET + 0x48)
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/* Number of internal PCI controllers */
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#define RCAR_PCI_NR_CONTROLLERS 3
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struct rcar_pci_priv {
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void __iomem *reg;
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struct resource io_res;
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struct resource mem_res;
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|
struct resource *cfg_res;
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int irq;
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|
};
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/* PCI configuration space operations */
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|
static void __iomem *rcar_pci_cfg_base(struct pci_bus *bus, unsigned int devfn,
|
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|
int where)
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|
{
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||||||
|
struct pci_sys_data *sys = bus->sysdata;
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||||||
|
struct rcar_pci_priv *priv = sys->private_data;
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int slot, val;
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if (sys->busnr != bus->number || PCI_FUNC(devfn))
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return NULL;
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/* Only one EHCI/OHCI device built-in */
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|
slot = PCI_SLOT(devfn);
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|
if (slot > 2)
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|
return NULL;
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val = slot ? RCAR_AHBPCI_WIN1_DEVICE | RCAR_AHBPCI_WIN_CTR_CFG :
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|
RCAR_AHBPCI_WIN1_HOST | RCAR_AHBPCI_WIN_CTR_CFG;
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||||||
|
iowrite32(val, priv->reg + RCAR_AHBPCI_WIN1_CTR_REG);
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return priv->reg + (slot >> 1) * 0x100 + where;
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||||||
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}
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|
static int rcar_pci_read_config(struct pci_bus *bus, unsigned int devfn,
|
||||||
|
int where, int size, u32 *val)
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|
{
|
||||||
|
void __iomem *reg = rcar_pci_cfg_base(bus, devfn, where);
|
||||||
|
|
||||||
|
if (!reg)
|
||||||
|
return PCIBIOS_DEVICE_NOT_FOUND;
|
||||||
|
|
||||||
|
switch (size) {
|
||||||
|
case 1:
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|
*val = ioread8(reg);
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||||||
|
break;
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|
case 2:
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|
*val = ioread16(reg);
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||||||
|
break;
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||||||
|
default:
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||||||
|
*val = ioread32(reg);
|
||||||
|
break;
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||||||
|
}
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||||||
|
|
||||||
|
return PCIBIOS_SUCCESSFUL;
|
||||||
|
}
|
||||||
|
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|
static int rcar_pci_write_config(struct pci_bus *bus, unsigned int devfn,
|
||||||
|
int where, int size, u32 val)
|
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|
{
|
||||||
|
void __iomem *reg = rcar_pci_cfg_base(bus, devfn, where);
|
||||||
|
|
||||||
|
if (!reg)
|
||||||
|
return PCIBIOS_DEVICE_NOT_FOUND;
|
||||||
|
|
||||||
|
switch (size) {
|
||||||
|
case 1:
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||||||
|
iowrite8(val, reg);
|
||||||
|
break;
|
||||||
|
case 2:
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||||||
|
iowrite16(val, reg);
|
||||||
|
break;
|
||||||
|
default:
|
||||||
|
iowrite32(val, reg);
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
return PCIBIOS_SUCCESSFUL;
|
||||||
|
}
|
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|
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|
/* PCI interrupt mapping */
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static int __init rcar_pci_map_irq(const struct pci_dev *dev, u8 slot, u8 pin)
|
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|
{
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|
struct pci_sys_data *sys = dev->bus->sysdata;
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|
struct rcar_pci_priv *priv = sys->private_data;
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|
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|
return priv->irq;
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|
}
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|
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|
/* PCI host controller setup */
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|
static int __init rcar_pci_setup(int nr, struct pci_sys_data *sys)
|
||||||
|
{
|
||||||
|
struct rcar_pci_priv *priv = sys->private_data;
|
||||||
|
void __iomem *reg = priv->reg;
|
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|
u32 val;
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||||||
|
val = ioread32(reg + RCAR_PCI_UNIT_REV_REG);
|
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|
pr_info("PCI: bus%u revision %x\n", sys->busnr, val);
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||||||
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|
/* Disable Direct Power Down State and assert reset */
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||||||
|
val = ioread32(reg + RCAR_USBCTR_REG) & ~RCAR_USBCTR_DIRPD;
|
||||||
|
val |= RCAR_USBCTR_USBH_RST | RCAR_USBCTR_PLL_RST;
|
||||||
|
iowrite32(val, reg + RCAR_USBCTR_REG);
|
||||||
|
udelay(4);
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|
/* De-assert reset and set PCIAHB window1 size to 1GB */
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|
val &= ~(RCAR_USBCTR_PCIAHB_WIN1_MASK | RCAR_USBCTR_PCICLK_MASK |
|
||||||
|
RCAR_USBCTR_USBH_RST | RCAR_USBCTR_PLL_RST);
|
||||||
|
iowrite32(val | RCAR_USBCTR_PCIAHB_WIN1_1G, reg + RCAR_USBCTR_REG);
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||||||
|
|
||||||
|
/* Configure AHB master and slave modes */
|
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|
iowrite32(RCAR_AHB_BUS_MODE, reg + RCAR_AHB_BUS_CTR_REG);
|
||||||
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|
||||||
|
/* Configure PCI arbiter */
|
||||||
|
val = ioread32(reg + RCAR_PCI_ARBITER_CTR_REG);
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||||||
|
val |= RCAR_PCI_ARBITER_PCIREQ0 | RCAR_PCI_ARBITER_PCIREQ1 |
|
||||||
|
RCAR_PCI_ARBITER_PCIBP_MODE;
|
||||||
|
iowrite32(val, reg + RCAR_PCI_ARBITER_CTR_REG);
|
||||||
|
|
||||||
|
/* PCI-AHB mapping: 0x40000000-0x80000000 */
|
||||||
|
iowrite32(0x40000000 | RCAR_PCIAHB_PREFETCH16,
|
||||||
|
reg + RCAR_PCIAHB_WIN1_CTR_REG);
|
||||||
|
|
||||||
|
/* AHB-PCI mapping: OHCI/EHCI registers */
|
||||||
|
val = priv->mem_res.start | RCAR_AHBPCI_WIN_CTR_MEM;
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||||||
|
iowrite32(val, reg + RCAR_AHBPCI_WIN2_CTR_REG);
|
||||||
|
|
||||||
|
/* Enable AHB-PCI bridge PCI configuration access */
|
||||||
|
iowrite32(RCAR_AHBPCI_WIN1_HOST | RCAR_AHBPCI_WIN_CTR_CFG,
|
||||||
|
reg + RCAR_AHBPCI_WIN1_CTR_REG);
|
||||||
|
/* Set PCI-AHB Window1 address */
|
||||||
|
iowrite32(0x40000000 | PCI_BASE_ADDRESS_MEM_PREFETCH,
|
||||||
|
reg + PCI_BASE_ADDRESS_1);
|
||||||
|
/* Set AHB-PCI bridge PCI communication area address */
|
||||||
|
val = priv->cfg_res->start + RCAR_AHBPCI_PCICOM_OFFSET;
|
||||||
|
iowrite32(val, reg + PCI_BASE_ADDRESS_0);
|
||||||
|
|
||||||
|
val = ioread32(reg + PCI_COMMAND);
|
||||||
|
val |= PCI_COMMAND_SERR | PCI_COMMAND_PARITY |
|
||||||
|
PCI_COMMAND_MEMORY | PCI_COMMAND_MASTER;
|
||||||
|
iowrite32(val, reg + PCI_COMMAND);
|
||||||
|
|
||||||
|
/* Enable PCI interrupts */
|
||||||
|
iowrite32(RCAR_PCI_INT_A | RCAR_PCI_INT_B | RCAR_PCI_INT_PME,
|
||||||
|
reg + RCAR_PCI_INT_ENABLE_REG);
|
||||||
|
|
||||||
|
/* Add PCI resources */
|
||||||
|
pci_add_resource(&sys->resources, &priv->io_res);
|
||||||
|
pci_add_resource(&sys->resources, &priv->mem_res);
|
||||||
|
|
||||||
|
return 1;
|
||||||
|
}
|
||||||
|
|
||||||
|
static struct pci_ops rcar_pci_ops = {
|
||||||
|
.read = rcar_pci_read_config,
|
||||||
|
.write = rcar_pci_write_config,
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct hw_pci rcar_hw_pci __initdata = {
|
||||||
|
.map_irq = rcar_pci_map_irq,
|
||||||
|
.ops = &rcar_pci_ops,
|
||||||
|
.setup = rcar_pci_setup,
|
||||||
|
};
|
||||||
|
|
||||||
|
static int rcar_pci_count __initdata;
|
||||||
|
|
||||||
|
static int __init rcar_pci_add_controller(struct rcar_pci_priv *priv)
|
||||||
|
{
|
||||||
|
void **private_data;
|
||||||
|
int count;
|
||||||
|
|
||||||
|
if (rcar_hw_pci.nr_controllers < rcar_pci_count)
|
||||||
|
goto add_priv;
|
||||||
|
|
||||||
|
/* (Re)allocate private data pointer array if needed */
|
||||||
|
count = rcar_pci_count + RCAR_PCI_NR_CONTROLLERS;
|
||||||
|
private_data = kzalloc(count * sizeof(void *), GFP_KERNEL);
|
||||||
|
if (!private_data)
|
||||||
|
return -ENOMEM;
|
||||||
|
|
||||||
|
rcar_pci_count = count;
|
||||||
|
if (rcar_hw_pci.private_data) {
|
||||||
|
memcpy(private_data, rcar_hw_pci.private_data,
|
||||||
|
rcar_hw_pci.nr_controllers * sizeof(void *));
|
||||||
|
kfree(rcar_hw_pci.private_data);
|
||||||
|
}
|
||||||
|
|
||||||
|
rcar_hw_pci.private_data = private_data;
|
||||||
|
|
||||||
|
add_priv:
|
||||||
|
/* Add private data pointer to the array */
|
||||||
|
rcar_hw_pci.private_data[rcar_hw_pci.nr_controllers++] = priv;
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int __init rcar_pci_probe(struct platform_device *pdev)
|
||||||
|
{
|
||||||
|
struct resource *cfg_res, *mem_res;
|
||||||
|
struct rcar_pci_priv *priv;
|
||||||
|
void __iomem *reg;
|
||||||
|
|
||||||
|
cfg_res = platform_get_resource(pdev, IORESOURCE_MEM, 0);
|
||||||
|
reg = devm_ioremap_resource(&pdev->dev, cfg_res);
|
||||||
|
if (!reg)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
mem_res = platform_get_resource(pdev, IORESOURCE_MEM, 1);
|
||||||
|
if (!mem_res || !mem_res->start)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
priv = devm_kzalloc(&pdev->dev,
|
||||||
|
sizeof(struct rcar_pci_priv), GFP_KERNEL);
|
||||||
|
if (!priv)
|
||||||
|
return -ENOMEM;
|
||||||
|
|
||||||
|
priv->mem_res = *mem_res;
|
||||||
|
/*
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||||||
|
* The controller does not support/use port I/O,
|
||||||
|
* so setup a dummy port I/O region here.
|
||||||
|
*/
|
||||||
|
priv->io_res.start = priv->mem_res.start;
|
||||||
|
priv->io_res.end = priv->mem_res.end;
|
||||||
|
priv->io_res.flags = IORESOURCE_IO;
|
||||||
|
|
||||||
|
priv->cfg_res = cfg_res;
|
||||||
|
|
||||||
|
priv->irq = platform_get_irq(pdev, 0);
|
||||||
|
priv->reg = reg;
|
||||||
|
|
||||||
|
return rcar_pci_add_controller(priv);
|
||||||
|
}
|
||||||
|
|
||||||
|
static struct platform_driver rcar_pci_driver = {
|
||||||
|
.driver = {
|
||||||
|
.name = "pci-rcar-gen2",
|
||||||
|
},
|
||||||
|
};
|
||||||
|
|
||||||
|
static int __init rcar_pci_init(void)
|
||||||
|
{
|
||||||
|
int retval;
|
||||||
|
|
||||||
|
retval = platform_driver_probe(&rcar_pci_driver, rcar_pci_probe);
|
||||||
|
if (!retval)
|
||||||
|
pci_common_init(&rcar_hw_pci);
|
||||||
|
|
||||||
|
/* Private data pointer array is not needed any more */
|
||||||
|
kfree(rcar_hw_pci.private_data);
|
||||||
|
rcar_hw_pci.private_data = NULL;
|
||||||
|
|
||||||
|
return retval;
|
||||||
|
}
|
||||||
|
|
||||||
|
subsys_initcall(rcar_pci_init);
|
||||||
|
|
||||||
|
MODULE_LICENSE("GPL v2");
|
||||||
|
MODULE_DESCRIPTION("Renesas R-Car Gen2 internal PCI");
|
||||||
|
MODULE_AUTHOR("Valentine Barshak <valentine.barshak@cogentembedded.com>");
|
||||||
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