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6.7 KiB
C
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C
/* SPDX-License-Identifier: GPL-2.0 */
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#ifndef __SOC_MEDIATEK_INFRACFG_H
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#define __SOC_MEDIATEK_INFRACFG_H
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#define MT8192_TOP_AXI_PROT_EN_STA1 0x228
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#define MT8192_TOP_AXI_PROT_EN_1_STA1 0x258
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#define MT8192_TOP_AXI_PROT_EN_SET 0x2a0
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#define MT8192_TOP_AXI_PROT_EN_CLR 0x2a4
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#define MT8192_TOP_AXI_PROT_EN_1_SET 0x2a8
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#define MT8192_TOP_AXI_PROT_EN_1_CLR 0x2ac
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#define MT8192_TOP_AXI_PROT_EN_MM_SET 0x2d4
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#define MT8192_TOP_AXI_PROT_EN_MM_CLR 0x2d8
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#define MT8192_TOP_AXI_PROT_EN_MM_STA1 0x2ec
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#define MT8192_TOP_AXI_PROT_EN_2_SET 0x714
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#define MT8192_TOP_AXI_PROT_EN_2_CLR 0x718
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#define MT8192_TOP_AXI_PROT_EN_2_STA1 0x724
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#define MT8192_TOP_AXI_PROT_EN_VDNR_SET 0xb84
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#define MT8192_TOP_AXI_PROT_EN_VDNR_CLR 0xb88
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#define MT8192_TOP_AXI_PROT_EN_VDNR_STA1 0xb90
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#define MT8192_TOP_AXI_PROT_EN_MM_2_SET 0xdcc
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#define MT8192_TOP_AXI_PROT_EN_MM_2_CLR 0xdd0
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#define MT8192_TOP_AXI_PROT_EN_MM_2_STA1 0xdd8
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#define MT8192_TOP_AXI_PROT_EN_DISP (BIT(6) | BIT(23))
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#define MT8192_TOP_AXI_PROT_EN_CONN (BIT(13) | BIT(18))
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#define MT8192_TOP_AXI_PROT_EN_CONN_2ND BIT(14)
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#define MT8192_TOP_AXI_PROT_EN_MFG1 GENMASK(22, 21)
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#define MT8192_TOP_AXI_PROT_EN_1_CONN BIT(10)
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#define MT8192_TOP_AXI_PROT_EN_1_MFG1 BIT(21)
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#define MT8192_TOP_AXI_PROT_EN_1_CAM BIT(22)
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#define MT8192_TOP_AXI_PROT_EN_2_CAM BIT(0)
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#define MT8192_TOP_AXI_PROT_EN_2_ADSP BIT(3)
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#define MT8192_TOP_AXI_PROT_EN_2_AUDIO BIT(4)
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#define MT8192_TOP_AXI_PROT_EN_2_MFG1 GENMASK(6, 5)
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#define MT8192_TOP_AXI_PROT_EN_2_MFG1_2ND BIT(7)
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#define MT8192_TOP_AXI_PROT_EN_MM_CAM (BIT(0) | BIT(2))
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#define MT8192_TOP_AXI_PROT_EN_MM_DISP (BIT(0) | BIT(2) | \
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BIT(10) | BIT(12) | \
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BIT(14) | BIT(16) | \
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BIT(24) | BIT(26))
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#define MT8192_TOP_AXI_PROT_EN_MM_CAM_2ND (BIT(1) | BIT(3))
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#define MT8192_TOP_AXI_PROT_EN_MM_DISP_2ND (BIT(1) | BIT(3) | \
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BIT(15) | BIT(17) | \
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BIT(25) | BIT(27))
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#define MT8192_TOP_AXI_PROT_EN_MM_ISP2 BIT(14)
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#define MT8192_TOP_AXI_PROT_EN_MM_ISP2_2ND BIT(15)
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#define MT8192_TOP_AXI_PROT_EN_MM_IPE BIT(16)
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#define MT8192_TOP_AXI_PROT_EN_MM_IPE_2ND BIT(17)
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#define MT8192_TOP_AXI_PROT_EN_MM_VDEC BIT(24)
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#define MT8192_TOP_AXI_PROT_EN_MM_VDEC_2ND BIT(25)
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#define MT8192_TOP_AXI_PROT_EN_MM_VENC BIT(26)
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#define MT8192_TOP_AXI_PROT_EN_MM_VENC_2ND BIT(27)
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#define MT8192_TOP_AXI_PROT_EN_MM_2_ISP BIT(8)
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#define MT8192_TOP_AXI_PROT_EN_MM_2_DISP (BIT(8) | BIT(12))
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#define MT8192_TOP_AXI_PROT_EN_MM_2_ISP_2ND BIT(9)
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#define MT8192_TOP_AXI_PROT_EN_MM_2_DISP_2ND (BIT(9) | BIT(13))
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#define MT8192_TOP_AXI_PROT_EN_MM_2_MDP BIT(12)
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#define MT8192_TOP_AXI_PROT_EN_MM_2_MDP_2ND BIT(13)
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#define MT8192_TOP_AXI_PROT_EN_VDNR_CAM BIT(21)
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#define MT8183_TOP_AXI_PROT_EN_STA1 0x228
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#define MT8183_TOP_AXI_PROT_EN_STA1_1 0x258
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#define MT8183_TOP_AXI_PROT_EN_SET 0x2a0
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#define MT8183_TOP_AXI_PROT_EN_CLR 0x2a4
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#define MT8183_TOP_AXI_PROT_EN_1_SET 0x2a8
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#define MT8183_TOP_AXI_PROT_EN_1_CLR 0x2ac
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#define MT8183_TOP_AXI_PROT_EN_MCU_SET 0x2c4
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#define MT8183_TOP_AXI_PROT_EN_MCU_CLR 0x2c8
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#define MT8183_TOP_AXI_PROT_EN_MCU_STA1 0x2e4
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#define MT8183_TOP_AXI_PROT_EN_MM_SET 0x2d4
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#define MT8183_TOP_AXI_PROT_EN_MM_CLR 0x2d8
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#define MT8183_TOP_AXI_PROT_EN_MM_STA1 0x2ec
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#define MT8183_TOP_AXI_PROT_EN_DISP (BIT(10) | BIT(11))
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#define MT8183_TOP_AXI_PROT_EN_CONN (BIT(13) | BIT(14))
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#define MT8183_TOP_AXI_PROT_EN_MFG (BIT(21) | BIT(22))
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#define MT8183_TOP_AXI_PROT_EN_CAM BIT(28)
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#define MT8183_TOP_AXI_PROT_EN_VPU_TOP BIT(27)
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#define MT8183_TOP_AXI_PROT_EN_1_DISP (BIT(16) | BIT(17))
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#define MT8183_TOP_AXI_PROT_EN_1_MFG GENMASK(21, 19)
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#define MT8183_TOP_AXI_PROT_EN_MM_ISP (BIT(3) | BIT(8))
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#define MT8183_TOP_AXI_PROT_EN_MM_ISP_2ND BIT(10)
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#define MT8183_TOP_AXI_PROT_EN_MM_CAM (BIT(4) | BIT(5) | \
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BIT(9) | BIT(13))
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#define MT8183_TOP_AXI_PROT_EN_MM_VPU_TOP (GENMASK(9, 6) | \
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BIT(12))
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#define MT8183_TOP_AXI_PROT_EN_MM_VPU_TOP_2ND (BIT(10) | BIT(11))
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#define MT8183_TOP_AXI_PROT_EN_MM_CAM_2ND BIT(11)
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#define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE0_2ND (BIT(0) | BIT(2) | \
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BIT(4))
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#define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE1_2ND (BIT(1) | BIT(3) | \
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BIT(5))
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#define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE0 BIT(6)
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#define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE1 BIT(7)
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#define MT8183_SMI_COMMON_CLAMP_EN 0x3c0
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#define MT8183_SMI_COMMON_CLAMP_EN_SET 0x3c4
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#define MT8183_SMI_COMMON_CLAMP_EN_CLR 0x3c8
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#define MT8183_SMI_COMMON_SMI_CLAMP_DISP GENMASK(7, 0)
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#define MT8183_SMI_COMMON_SMI_CLAMP_VENC BIT(1)
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#define MT8183_SMI_COMMON_SMI_CLAMP_ISP BIT(2)
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#define MT8183_SMI_COMMON_SMI_CLAMP_CAM (BIT(3) | BIT(4))
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#define MT8183_SMI_COMMON_SMI_CLAMP_VPU_TOP (BIT(5) | BIT(6))
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#define MT8183_SMI_COMMON_SMI_CLAMP_VDEC BIT(7)
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#define MT8173_TOP_AXI_PROT_EN_MCI_M2 BIT(0)
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#define MT8173_TOP_AXI_PROT_EN_MM_M0 BIT(1)
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#define MT8173_TOP_AXI_PROT_EN_MM_M1 BIT(2)
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#define MT8173_TOP_AXI_PROT_EN_MMAPB_S BIT(6)
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#define MT8173_TOP_AXI_PROT_EN_L2C_M2 BIT(9)
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#define MT8173_TOP_AXI_PROT_EN_L2SS_SMI BIT(11)
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#define MT8173_TOP_AXI_PROT_EN_L2SS_ADD BIT(12)
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#define MT8173_TOP_AXI_PROT_EN_CCI_M2 BIT(13)
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#define MT8173_TOP_AXI_PROT_EN_MFG_S BIT(14)
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#define MT8173_TOP_AXI_PROT_EN_PERI_M0 BIT(15)
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#define MT8173_TOP_AXI_PROT_EN_PERI_M1 BIT(16)
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#define MT8173_TOP_AXI_PROT_EN_DEBUGSYS BIT(17)
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#define MT8173_TOP_AXI_PROT_EN_CQ_DMA BIT(18)
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#define MT8173_TOP_AXI_PROT_EN_GCPU BIT(19)
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#define MT8173_TOP_AXI_PROT_EN_IOMMU BIT(20)
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#define MT8173_TOP_AXI_PROT_EN_MFG_M0 BIT(21)
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#define MT8173_TOP_AXI_PROT_EN_MFG_M1 BIT(22)
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#define MT8173_TOP_AXI_PROT_EN_MFG_SNOOP_OUT BIT(23)
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#define MT8167_TOP_AXI_PROT_EN_MM_EMI BIT(1)
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#define MT8167_TOP_AXI_PROT_EN_MCU_MFG BIT(2)
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#define MT8167_TOP_AXI_PROT_EN_CONN_EMI BIT(4)
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#define MT8167_TOP_AXI_PROT_EN_MFG_EMI BIT(5)
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#define MT8167_TOP_AXI_PROT_EN_CONN_MCU BIT(8)
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#define MT8167_TOP_AXI_PROT_EN_MCU_CONN BIT(9)
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#define MT8167_TOP_AXI_PROT_EN_MCU_MM BIT(11)
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#define MT2701_TOP_AXI_PROT_EN_MM_M0 BIT(1)
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#define MT2701_TOP_AXI_PROT_EN_CONN_M BIT(2)
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#define MT2701_TOP_AXI_PROT_EN_CONN_S BIT(8)
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#define MT7622_TOP_AXI_PROT_EN_ETHSYS (BIT(3) | BIT(17))
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#define MT7622_TOP_AXI_PROT_EN_HIF0 (BIT(24) | BIT(25))
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#define MT7622_TOP_AXI_PROT_EN_HIF1 (BIT(26) | BIT(27) | \
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BIT(28))
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#define MT7622_TOP_AXI_PROT_EN_WB (BIT(2) | BIT(6) | \
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BIT(7) | BIT(8))
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#define INFRA_TOPAXI_PROTECTEN 0x0220
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#define INFRA_TOPAXI_PROTECTSTA1 0x0228
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#define INFRA_TOPAXI_PROTECTEN_SET 0x0260
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#define INFRA_TOPAXI_PROTECTEN_CLR 0x0264
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#define REG_INFRA_MISC 0xf00
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#define F_DDR_4GB_SUPPORT_EN BIT(13)
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int mtk_infracfg_set_bus_protection(struct regmap *infracfg, u32 mask,
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bool reg_update);
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int mtk_infracfg_clear_bus_protection(struct regmap *infracfg, u32 mask,
|
|
bool reg_update);
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#endif /* __SOC_MEDIATEK_INFRACFG_H */
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